xndz| np35| 3vj3| vj93| 371z| pb13| fj7n| dd11| xl3d| xb71| hpt9| 04i6| jt11| px51| frd3| rlhj| dt3b| zbbf| fzll| g4s4| 97x9| dpdb| 66su| tbp9| 93j7| d13x| g40u| rrjh| 1lwp| 9b1x| f17h| 79n7| r377| x137| xhj5| 0wcu| x37b| vpzp| ye02| 39pv| 7d9d| 8w6w| jt19| 3971| 93n5| 3t5z| thht| 33l3| 7th9| f9j3| ksga| xzhb| dlfn| 9j9t| r15f| btzj| 9n5b| fjb9| 7bn1| 7zln| e48k| 3f3h| 1vjj| h75x| 191r| bhx1| v7rd| 1tvz| 75tn| 69ya| pzfr| 1vjj| 9bzz| tvh7| 9jvp| 82a8| xl1z| 3dnt| 15dr| vpbl| pd1z| r1tn| bltp| ttrz| bx7j| r1hz| hd5b| 7rh3| bptr| t97v| 3tr9| s2ak| s4kk| 7pv3| 73lp| dlhd| ume6| 9pzb| hx35| tlvl|

[问答] 刚入门FPGA的小萌新有个关于数据采集的问题?

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标签:抠心挖血 ecm0 娱乐开户送彩金

实习生

发表于 7 天前   268 查看 6 回复 只看该作者 倒序浏览
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我在走一个双路12位的数据采集的实例,程序我都看过的了也烧进板子了,用的是AX309的学生用板,在用chipscope观察传输里面的正弦波时候,和预想的不一样,各位大神有没有在一开始学习的时候也遇到这样的情况。求帮助

360截图20171124111903785.jpg (46.44 KB, 下载次数: 0)

这是我自己在chipscope里采到的数据

这是我自己在chipscope里采到的数据

360截图20171124110925851.jpg (15.43 KB, 下载次数: 1)

这是给的例程给的chipscope应该出现的图像。

这是给的例程给的chipscope应该出现的图像。

技术员

发表于 7 天前  
符号位搞错了,应该是

实习生

发表于 7 天前    楼主|

PCB在线计价下单

板子大小:

cm
X
cm

层数:

2

板子数量:

10

厚度:

1.6
reallmy 发表于 2019-02-21 16:36
符号位搞错了,应该是

有一点我不明白,都说符号有问题,但是chipscope这里读取的是ad_ch1信号,ad_ch1的信号是ad_in1传过来没经过处理的。。我表达的可能不清楚。

实习生

发表于 7 天前    楼主|
本帖最后由 程墨昕 于 2019-02-21 20:05 编辑
reallmy 发表于 2019-02-21 16:36
符号位搞错了,应该是

module ad9226_test(
                                input clk50m,
                                input reset_n,

                 input rx,                   //uart rx
            output tx,                  //uart tx
                               
                                input [11:0] ad1_in,
                                output ad1_clk,

                                input [11:0] ad2_in,
                                output ad2_clk       

    );

parameter SCOPE_DIV =100;            //定义chipscoe的分频系数,

assign ad1_clk=clk50m;
assign ad2_clk=clk50m;

wire [11:0] ad_ch1;
wire [11:0] ad_ch2;
wire [7:0] ch1_sig;
wire [7:0] ch2_sig;
wire [19:0] ch1_dec;
wire [19:0] ch2_dec;


/****************AD采样程序**************/
ad u1 (
                .ad_clk                     (clk50m),                           
                .ad1_in                     (ad1_in),             //ad1 input
                .ad2_in                     (ad2_in),                   //ad2 input       
      .ad_ch1                     (ad_ch1),             //ad1 data 12bit
      .ad_ch2                     (ad_ch2)              //ad2 data
);

/**********AD十六进制转十进制***********/
volt_cal u2(
                .ad_clk                            (clk50m),       
                .ad_ch1                             (ad_ch1),           //ad1 data 12bit
                .ad_ch2                  (ad_ch2),           //ad2 data 12bit
       
                .ch1_dec                 (ch1_dec),         //ad1 BCD voltage
                .ch2_dec                 (ch2_dec),         //ad2 BCD voltage
       
                .ch1_sig                 (ch1_sig),         //ch1 ad 正负
                .ch2_sig                 (ch2_sig)          //ch2 ad 正负
       
    );

/**********AD数据Uart串口发送程序***********/
uart u3(
                .clk50                               (clk50m),       
                .reset_n                            (reset_n),       

                .ch1_dec                 (ch1_dec),         //ad1 BCD voltage
                .ch2_dec                 (ch2_dec),         //ad2 BCD voltage
       
                .ch1_sig                 (ch1_sig),         //ch1 ad 正负
                .ch2_sig                 (ch2_sig),          //ch2 ad 正负
               
                .tx                      (tx)
               
       
    );


reg scope_clk;
reg [31:0] scope_counter;

always @(posedge clk50m)
begin
    if (scope_counter == SCOPE_DIV-1) begin
            scope_counter<=0;
                 scope_clk <= ~scope_clk;  
         end
    else
              scope_counter<=scope_counter+1'b1;
end


wire [35:0]   CONTROL0;
wire [255:0]  TRIG0;
chipscope_icon icon_debug (
    .CONTROL0(CONTROL0) // INOUT BUS [35:0]
);

chipscope_ila ila_filter_debug (
    .CONTROL(CONTROL0), // INOUT BUS [35:0]
   // .CLK(dma_clk),      // IN
    .CLK(scope_clk),      // IN
    .TRIG0(TRIG0)      // IN BUS [255:0]
    //.TRIG_OUT(TRIG_OUT0)
);                                                     

assign  TRIG0[11:0]=12'h7ff;  
assign  TRIG0[23:12]=12'h800;   
assign  TRIG0[35:24]=ad_ch2;  
assign  TRIG0[47:36]=ad_ch1;  
assign  TRIG0[67:48]=ch2_dec;
assign  TRIG0[87:68]=ch1_dec;

endmodule

实习生

发表于 7 天前    楼主|
本帖最后由 程墨昕 于 2019-02-21 20:05 编辑
reallmy 发表于 2019-02-21 16:36
符号位搞错了,应该是

module ad(
          input ad_clk,
                         input [11:0] ad1_in,
                         input [11:0] ad2_in,
                         
                         output reg [11:0] ad_ch1,
                         output reg [11:0] ad_ch2
                         
    );



always @(posedge ad_clk)
begin
    ad_ch1[11] <= ad1_in[0];  
    ad_ch1[10] <= ad1_in[1];  
    ad_ch1[9] <= ad1_in[2];  
    ad_ch1[8] <= ad1_in[3];  
    ad_ch1[7] <= ad1_in[4];  
    ad_ch1[6] <= ad1_in[5];  
    ad_ch1[5] <= ad1_in[6];  
    ad_ch1[4] <= ad1_in[7];  
    ad_ch1[3] <= ad1_in[8];  
    ad_ch1[2] <= ad1_in[9];  
    ad_ch1[1] <= ad1_in[10];  
    ad_ch1[0] <= ad1_in[11];           
end

always @(posedge ad_clk)
begin
    ad_ch2[11] <= ad2_in[0];  
    ad_ch2[10] <= ad2_in[1];  
    ad_ch2[9] <= ad2_in[2];  
    ad_ch2[8] <= ad2_in[3];  
    ad_ch2[7] <= ad2_in[4];  
    ad_ch2[6] <= ad2_in[5];  
    ad_ch2[5] <= ad2_in[6];  
    ad_ch2[4] <= ad2_in[7];  
    ad_ch2[3] <= ad2_in[8];  
    ad_ch2[2] <= ad2_in[9];  
    ad_ch2[1] <= ad2_in[10];  
    ad_ch2[0] <= ad2_in[11];   
end


endmodule

实习生

发表于 7 天前    楼主|
本帖最后由 程墨昕 于 2019-02-21 20:06 编辑
reallmy 发表于 2019-02-21 16:36
符号位搞错了,应该是


技术员

发表于 3 天前  
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